如何在org-mode中插入verilog代码？

Org-mode
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如何在org-mode中插入verilog代码？网上好像都没有插入verilog代码的标识符。

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如果你装了 verilog mode 之类的，用 #+begin_src verilog就行。

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如果想要像Markdown一样通过```插入行间代码，应该怎么做？

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  • 输入 <s 然后按 TAB：

    #+BEGIN_SRC |<--- 光标停在这里

#+END_SRC

    更多模版看 C-h v org-structure-template-alist，可以自行扩展

  • yasnippet 添加更具体的模版，例如 <py:

    #+BEGIN_SRC python :results |output :preamble "# -*- coding: utf-8 -*-"

#+END_SRC
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这个功能在 org-mode 最新的版本中发生了很大的变化，到时候记得看文档。

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啊！找到了，真的谢谢啦！